113 年 國立中山大學電機工程學系碩士班甲組《半導體概論》
第 1 題10 分
(10%) Please explain what a degenerate semiconductor is and the freeze-out effect.
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本題主要在探討半導體的兩種特殊現象:簡併半導體 (degenerate semiconductor) 與凍結效應 (freeze-out effect)。
簡併半導體 (Degenerate Semiconductor)
簡併半導體是指半導體中的載子濃度(電子或電洞)非常高,以至於其費米能階 (Fermi level, ) 進入導帶 (conduction band) 或價帶 (valence band)。這意味著載子的行為不再遵循經典的麥克斯韋-玻爾茲曼統計 (Maxwell-Boltzmann statistics),而是必須使用量子力學的費米-狄拉克統計 (Fermi-Dirac statistics)。
在簡併半導體中:
- N 型簡併半導體: 當摻雜濃度非常高時,導帶底部的電子濃度極高,使得費米能階 高於導帶底部的能量 。此時,大部分的能階都被電子佔據,電子行為類似於金屬中的自由電子。
- P 型簡併半導體: 當摻雜濃度非常高時,價帶頂部的電洞濃度極高,使得費米能階 低於價帶頂部的能量 。
第 2 題5 分
(5%) How to achieve ohmic contact for a metal/semiconductor junction? Please provide two methods.
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本題考驗金屬與半導體形成歐姆接觸 (Ohmic contact) 的方法。歐姆接觸是指金屬與半導體之間形成一個低電阻的接觸,使得電流可以線性地通過,不受接觸電阻的限制。這通常需要降低金屬與半導體之間的能障 (barrier height),或極大地增加半導體的摻雜濃度。
以下是兩種常見的達成歐姆接觸的方法:
-
高摻雜濃度法 (Highly Doped Semiconductor)
- 原理: 將半導體在金屬接觸的區域進行極高濃度的摻雜(N 型半導體則摻雜施體,P 型半導體則摻雜受體)。當摻雜濃度達到簡併半導體 (degenerate semiconductor) 的程度時,半導體的導帶底或價帶頂的能階會被載子充滿,此時金屬與半導體之間的蕭特基勢壘 (Schottky barrier) 會變得非常窄。
- 效應: 由於勢壘極窄,載子可以透過量子穿隧效應 (quantum tunneling) 輕易地穿過勢壘,即使金屬與半導體之間的功函數差 (work function difference) 較大,也能形成低電阻的歐姆接觸。
- 實務: 對於 N 型半導體,通常將其摻雜到 以上;對於 P 型半導體,則摻雜到 以上。
-
選擇合適的金屬 (Choosing the Right Metal)
第 3 題20 分
The values of effective density of states function in the conduction band Ne and valence band
Ny for a semiconductor at T = 300 K are 3 × 1019 cm³ and 2 × 1019 cm³, respectively.
Assume the bandgap energy of the semiconductor is 1 eV and does not vary over this temperature
range.
(a) Calculate the intrinsic concentration of the semiconductor at T = 300 K and 400K, respectively. (10%)
(b) Based on the previous question, if this semiconductor is doped with both donor Na = 1013 cm³ and
acceptor Na = 3 × 1013 cm³. What are the carrier concentrations of electrons and holes at T = 400 K? (10%)
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核心觀念
本題考查半導體的本質載子濃度、溫度對有效狀態密度的影響,以及摻雜半導體的電中性條件。
非簡併、熱平衡且完全游離時,主要公式為:
其中:
- :本質載子濃度
- :導帶有效狀態密度
- :價帶有效狀態密度
- :能隙
- :波茲曼常數
有效狀態密度與溫度的關係為:
因此:
題目中的 應為導帶與價帶有效狀態密度 ,單位應為 ;摻雜濃度中的 應依上下文分別理解為施體濃度 與受體濃度 。
解題方法
(a)計算 與 的本質濃度
已知:
先計算有效狀態密度的幾何平均:
在 時:
因此:
先求 時的有效狀態密度:
所以:
其幾何平均為:
在 時:
因此:
第 4 題15 分
A semiconductor Hall device at T = 300 K has following geometry as shown in Fig. 1: d = 10-2 cm, W = 0.1 cm, and L = 1 cm. The following parameters are measured: Ix = 5 mA, Vx = 10 V, VH = -5 mV, and Bz = 0.1 tesla. Determine (a) conductivity type (please explain whether this semiconductor is of n-type or p-type) (5%), (b) majority concentration (5%), and (c) majority carrier mobility. (5%)
🖼️【此處有附圖,請對照原卷】
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核心觀念
本題考查 Hall effect 的三項判定:
- 由 Hall 電壓極性判斷導電型態。
- 由 Hall coefficient 求多數載子濃度。
- 由電導率求多數載子 mobility。
相關公式為
其中 為試片厚度。單一載子主導時,
且
(a) 導電型態
依圖示電流方向、磁場方向與 Hall 電壓極性,量得
Hall coefficient 為負值,因此主要載子為電子,試片屬於 n-type 半導體。
(b) 多數載子濃度
先將厚度換成 SI 單位:
Hall coefficient:
因此電子濃度為
換算成 :
(c) 多數載子遷移率
試片電導率為
第 5 題30 分
Consider a uniformly doped silicon pn junction at T = 300 K. At zero bias, 20 percent of the total space charge region is in the n-region. The built-in potential barrier is Vbi = 0.75 V.
(a) Determine dopant concentration and depletion width in p-region and n-region, respectively. (i.e. determine Na, Nd, Xn, Xp) (20%)
(b) Determine the maximum electric field (Emax) and junction capacitance density Cj. (10%)
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核心觀念
本題考查均勻摻雜矽 接面的耗盡區分析,主要使用:
-
耗盡區電荷中性:
-
耗盡區總寬度:
-
矽 接面的內建電位:
-
耗盡區寬度:
-
最大電場與接面電容密度:
取 時:
矽的本質載子濃度採用:
矽介電常數為:
解題方法
1. 利用空間電荷區比例求 與 的關係
題目指出總耗盡區中,位於 區的部分占 ,因此:
而位於 區的部分占 :
接面必須滿足電荷中性:
消去 ,代入 與 :
因此:
也就是:
區的摻雜濃度較高,因此耗盡區在 區較窄,這與題目給定的 相符。
2. 利用內建電位求摻雜濃度
內建電位公式為:
代入 、:
因此:
所以:
又因為 :
故:
3. 求總耗盡區寬度
耗盡區寬度為:
先計算濃度項:
第 6 題20 分
A MOS-Capacitor with metal work function 4.6 eV, gate insulator SiO2 with thickness 15 nm, silicon substrate with boron doped (p-type) to 1 x 1017 cm³ at T= 300 K. Please find out (a) the ideal flat-band voltage VFB (5%), (b) flat-band capacitance density (5%), (c) ideal threshold voltage VTH (5%), and (d) saturated depletion width (5%). The VTH means the MOC-Cap is biased into strong inversion.
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核心觀念
本題是理想 MOS 電容器分析,假設:
- 氧化層內無固定電荷;
- Si–SiO₂ 界面無界面電荷;
- 金屬閘極與矽基板均達熱平衡;
- 題目中的摻雜濃度解讀為 ;
- 矽的電子親和力取 ;
- 、。
此題依序使用:
- 金屬—半導體功函數差求平帶電壓;
- 氧化層電容與半導體平帶電容串聯求總平帶電容;
- 強反轉條件 求臨界電壓;
- 最大空乏電荷求飽和空乏寬度。
取
(a) 理想平帶電壓
1. 求基板費米電位
室溫下熱電壓為
對 型矽基板,
代入數值:
2. 求矽基板功函數
矽的功函數為
因此
金屬功函數為
理想平帶電壓為金屬—半導體功函數差:
所以
因此
負號表示金屬功函數小於 型矽基板功函數。
(b) 平帶電容密度
平帶時,MOS 電容由氧化層電容與半導體電容串聯而成。
1. 氧化層電容密度
氧化層厚度為
氧化層電容密度:
代入:
2. 平帶時的半導體電容密度
德拜長度為
其中
因此
平帶時半導體電容密度:
3. MOS 平帶電容密度
串聯電容為
代入:
因此